職位描述
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職位描述:
職責(zé)描述:
1. 負(fù)責(zé) fpga 產(chǎn)品設(shè)計(jì)、仿真、測試等;
2. 實(shí)時(shí)信號(hào)包絡(luò)檢查和納秒級(jí)到達(dá)時(shí)間測量相關(guān)的硬件算法設(shè)計(jì)和實(shí) 現(xiàn);
3. 獨(dú)立承擔(dān)數(shù)字信號(hào)處理算法在 fpga 或 dsp 上的實(shí)現(xiàn),完成實(shí)時(shí)的 高速信號(hào)處理功能;
4. 完成主管交代的其他工作。
任職要求:
1. 熟練使用 altera 或 xilinx eda 開發(fā)工具,熟練使用 modelsim 等仿 真工具。
2. 熟練使用 verilog 或 vhdl 硬件描述語言和 c 語言
3. 有雷達(dá)信號(hào)處理、到達(dá)時(shí)間測量 (toa) 、基站信號(hào)處理等相關(guān)項(xiàng)目 經(jīng)歷者優(yōu)先。
4. 具有 2 年以上 fpga、dsp 研發(fā)經(jīng)驗(yàn)。
5. 工作認(rèn)真負(fù)責(zé)、有良好的文檔記錄。
職責(zé)描述:
1. 負(fù)責(zé) fpga 產(chǎn)品設(shè)計(jì)、仿真、測試等;
2. 實(shí)時(shí)信號(hào)包絡(luò)檢查和納秒級(jí)到達(dá)時(shí)間測量相關(guān)的硬件算法設(shè)計(jì)和實(shí) 現(xiàn);
3. 獨(dú)立承擔(dān)數(shù)字信號(hào)處理算法在 fpga 或 dsp 上的實(shí)現(xiàn),完成實(shí)時(shí)的 高速信號(hào)處理功能;
4. 完成主管交代的其他工作。
任職要求:
1. 熟練使用 altera 或 xilinx eda 開發(fā)工具,熟練使用 modelsim 等仿 真工具。
2. 熟練使用 verilog 或 vhdl 硬件描述語言和 c 語言
3. 有雷達(dá)信號(hào)處理、到達(dá)時(shí)間測量 (toa) 、基站信號(hào)處理等相關(guān)項(xiàng)目 經(jīng)歷者優(yōu)先。
4. 具有 2 年以上 fpga、dsp 研發(fā)經(jīng)驗(yàn)。
5. 工作認(rèn)真負(fù)責(zé)、有良好的文檔記錄。
工作地點(diǎn)
地址:合肥蜀山區(qū)合肥-蜀山區(qū)
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詳細(xì)位置,可以參考上方地址信息
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公司性質(zhì)未知
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注:聯(lián)系我時(shí),請(qǐng)說是在江蘇人才網(wǎng)上看到的。
