應(yīng)屆畢業(yè)生
本科
2026-04-09 15:50:13
1383人關(guān)注
職位描述
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Brief Description / 職位概述
This role will be responsible for the FPGA design and verification, which include defining top-level architecture as well as sub-level architecture, RTL coding, synthesizing, P
This role will be responsible for the FPGA design and verification, which include defining top-level architecture as well as sub-level architecture, RTL coding, synthesizing, P
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工作地點
地址：成都武侯區(qū)知識產(chǎn)權(quán)金融大廈1棟1單元705號昂際智航
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職位發(fā)布者
cass..HR
上海力德人才服務(wù)有限公司
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私營·民營企業(yè)
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梅園路77號
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