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【工作內(nèi)容】
- 負(fù)責(zé)新品程序開發(fā)的評估及報(bào)價(jià)；
- 負(fù)責(zé)測試產(chǎn)品PCB板、針卡的設(shè)計(jì)、焊接及維修；
- 新品測試程序的編寫，調(diào)試及程序的互審；
- 負(fù)責(zé)新品的順利導(dǎo)入；
- 測試程序開發(fā)進(jìn)度的匯報(bào)及相關(guān)文件的編寫；
- 負(fù)責(zé)客戶投訴產(chǎn)品驗(yàn)證；
- 工程批良率報(bào)表的提供；
- 負(fù)責(zé)對相關(guān)工程師、技術(shù)員進(jìn)行技能培訓(xùn)及業(yè)務(wù)指導(dǎo)工作；
- 擬制特殊測試方式等特殊流程的文件；
- 測試技術(shù)難題進(jìn)行攻關(guān)；
- 協(xié)助異常處理工程師對重點(diǎn)產(chǎn)品的異常分析處理工作；
- 負(fù)責(zé)測試程序的優(yōu)化；
- PWS測試程序?qū)徍耍?br />- 重點(diǎn)產(chǎn)品測試良率分析與管理；
- 完成領(lǐng)導(dǎo)交辦的其他工作任務(wù)。
【任職要求】
- 計(jì)算機(jī)科學(xué)、電子工程或相關(guān)專業(yè)本科及以上學(xué)歷；
- 至少2年的半導(dǎo)體行業(yè)SOC測試開發(fā)經(jīng)驗(yàn)，熟悉SOC設(shè)計(jì)流程和測試技術(shù)；
- 熟悉Verilog/HDL語言，有實(shí)際的SOC設(shè)計(jì)和測試經(jīng)驗(yàn)者優(yōu)先；
- 具備良好的問題解決能力、團(tuán)隊(duì)協(xié)作能力和溝通能力；
- 熟悉常見的集成電路測試設(shè)備和測試軟件，如Logic Analyzer、Scope等；
- 能夠獨(dú)立完成測試方案的設(shè)計(jì)和實(shí)施，具備良好的文檔編寫能力；
- 對新技術(shù)保持學(xué)習(xí)熱情，愿意接受挑戰(zhàn)和成長。